begriffs open source - cmsis/blob - main/Core/group__Core__Register__gr.html

   1 <!-- HTML header for doxygen 1.9.6-->
   2 <!DOCTYPE html PUBLIC "-//W3C//DTD XHTML 1.0 Transitional//EN" "https://www.w3.org/TR/xhtml1/DTD/xhtml1-transitional.dtd">
   3 <html xmlns="http://www.w3.org/1999/xhtml" lang="en-US">
   4 <head>
   5 <meta http-equiv="Content-Type" content="text/xhtml;charset=UTF-8"/>
   6 <meta http-equiv="X-UA-Compatible" content="IE=11"/>
   7 <meta name="viewport" content="width=device-width, initial-scale=1"/>
   8 <title>CMSIS-Core (Cortex-M): Core Register Access</title>
   9 <link href="doxygen.css" rel="stylesheet" type="text/css" />
  10 <script type="text/javascript" src="jquery.js"></script>
  11 <script type="text/javascript" src="dynsections.js"></script>
  12 <script type="text/javascript" src="tabs.js"></script>
  13 <script type="text/javascript" src="footer.js"></script>
  14 <script type="text/javascript" src="navtree.js"></script>
  15 <link href="navtree.css" rel="stylesheet" type="text/css"/>
  16 <script type="text/javascript" src="resize.js"></script>
  17 <script type="text/javascript" src="navtreedata.js"></script>
  18 <script type="text/javascript" src="navtree.js"></script>
  19 <link href="search/search.css" rel="stylesheet" type="text/css"/>
  20 <script type="text/javascript" src="search/searchdata.js"></script>
  21 <script type="text/javascript" src="search/search.js"></script>
  22 <script type="text/javascript">
  23 /* @license magnet:?xt=urn:btih:d3d9a9a6595521f9666a5e94cc830dab83b65699&amp;dn=expat.txt MIT */
  24   $(document).ready(function() { init_search(); });
  25 /* @license-end */
  26 </script>
  27 <script type="text/javascript" src="darkmode_toggle.js"></script>
  28 <link href="extra_stylesheet.css" rel="stylesheet" type="text/css"/>
  29 <link href="extra_navtree.css" rel="stylesheet" type="text/css"/>
  30 <link href="extra_search.css" rel="stylesheet" type="text/css"/>
  31 <link href="extra_tabs.css" rel="stylesheet" type="text/css"/>
  32 <link href="version.css" rel="stylesheet" type="text/css"/>
  33 <script type="text/javascript" src="../../version.js"></script>
  34 </head>
  35 <body>
  36 <div id="top"><!-- do not remove this div, it is closed by doxygen! -->
  37 <div id="titlearea">
  38 <table cellspacing="0" cellpadding="0">
  39  <tbody>
  40  <tr style="height: 55px;">
  41   <td id="projectlogo" style="padding: 1.5em;"><img alt="Logo" src="cmsis_logo_white_small.png"/></td>
  42   <td style="padding-left: 1em; padding-bottom: 1em;padding-top: 1em;">
  43    <div id="projectname">CMSIS-Core (Cortex-M)
  44    &#160;<span id="projectnumber"><script type="text/javascript">
  45      <!--
  46      writeHeader.call(this);
  47      writeVersionDropdown.call(this, "CMSIS-Core (Cortex-M)");
  48      //-->
  49     </script>
  50    </span>
  51    </div>
  52    <div id="projectbrief">CMSIS-Core support for Cortex-M processor-based devices</div>
  53   </td>
  54    <td>        <div id="MSearchBox" class="MSearchBoxInactive">
  55         <span class="left">
  56           <span id="MSearchSelect"                onmouseover="return searchBox.OnSearchSelectShow()"                onmouseout="return searchBox.OnSearchSelectHide()">&#160;</span>
  57           <input type="text" id="MSearchField" value="" placeholder="Search" accesskey="S"
  58                onfocus="searchBox.OnSearchFieldFocus(true)"
  59                onblur="searchBox.OnSearchFieldFocus(false)"
  60                onkeyup="searchBox.OnSearchFieldChange(event)"/>
  61           </span><span class="right">
  62             <a id="MSearchClose" href="javascript:searchBox.CloseResultsWindow()"><img id="MSearchCloseImg" border="0" src="search/close.svg" alt=""/></a>
  63           </span>
  64         </div>
  65 </td>
  66   <!--END !PROJECT_NAME-->
  67  </tr>
  68  </tbody>
  69 </table>
  70 </div>
  71 <!-- end header part -->
  72 <div id="CMSISnav" class="tabs1">
  73   <ul class="tablist">
  74     <script type="text/javascript">
  75       writeComponentTabs.call(this);
  76     </script>
  77   </ul>
  78 </div>
  79 <script type="text/javascript">
  80   writeSubComponentTabs.call(this);
  81 </script>
  82 <!-- Generated by Doxygen 1.9.6 -->
  83 <script type="text/javascript">
  84 /* @license magnet:?xt=urn:btih:d3d9a9a6595521f9666a5e94cc830dab83b65699&amp;dn=expat.txt MIT */
  85 var searchBox = new SearchBox("searchBox", "search/",'.html');
  86 /* @license-end */
  87 </script>
  88 </div><!-- top -->
  89 <div id="side-nav" class="ui-resizable side-nav-resizable">
  90   <div id="nav-tree">
  91     <div id="nav-tree-contents">
  92       <div id="nav-sync" class="sync"></div>
  93     </div>
  94   </div>
  95   <div id="splitbar" style="-moz-user-select:none;"
  96        class="ui-resizable-handle">
  97   </div>
  98 </div>
  99 <script type="text/javascript">
 100 /* @license magnet:?xt=urn:btih:d3d9a9a6595521f9666a5e94cc830dab83b65699&amp;dn=expat.txt MIT */
 101 $(document).ready(function(){initNavTree('group__Core__Register__gr.html',''); initResizable(); });
 102 /* @license-end */
 103 </script>
 104 <div id="doc-content">
 105 <!-- window showing the filter options -->
 106 <div id="MSearchSelectWindow"
 107      onmouseover="return searchBox.OnSearchSelectShow()"
 108      onmouseout="return searchBox.OnSearchSelectHide()"
 109      onkeydown="return searchBox.OnSearchSelectKey(event)">
 110 </div>
 111
 112 <!-- iframe showing the search results (closed by default) -->
 113 <div id="MSearchResultsWindow">
 114 <div id="MSearchResults">
 115 <div class="SRPage">
 116 <div id="SRIndex">
 117 <div id="SRResults"></div>
 118 <div class="SRStatus" id="Loading">Loading...</div>
 119 <div class="SRStatus" id="Searching">Searching...</div>
 120 <div class="SRStatus" id="NoMatches">No Matches</div>
 121 </div>
 122 </div>
 123 </div>
 124 </div>
 125
 126 <div class="header">
 127   <div class="summary">
 128 <a href="#func-members">Functions</a>  </div>
 129   <div class="headertitle"><div class="title">Core Register Access</div></div>
 130 </div><!--header-->
 131 <div class="contents">
 132
 133 <p>Functions to access the Cortex-M core registers.
 134 <a href="#details">More...</a></p>
 135 <table class="memberdecls">
 136 <tr class="heading"><td colspan="2"><h2 class="groupheader"><a id="func-members" name="func-members"></a>
 137 Functions</h2></td></tr>
 138 <tr class="memitem:ga963cf236b73219ce78e965deb01b81a7"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga963cf236b73219ce78e965deb01b81a7">__get_CONTROL</a> (void)</td></tr>
 139 <tr class="memdesc:ga963cf236b73219ce78e965deb01b81a7"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the CONTROL register.  <br /></td></tr>
 140 <tr class="separator:ga963cf236b73219ce78e965deb01b81a7"><td class="memSeparator" colspan="2">&#160;</td></tr>
 141 <tr class="memitem:gac64d37e7ff9de06437f9fb94bbab8b6c"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c">__set_CONTROL</a> (uint32_t control)</td></tr>
 142 <tr class="memdesc:gac64d37e7ff9de06437f9fb94bbab8b6c"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the CONTROL Register.  <br /></td></tr>
 143 <tr class="separator:gac64d37e7ff9de06437f9fb94bbab8b6c"><td class="memSeparator" colspan="2">&#160;</td></tr>
 144 <tr class="memitem:ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8">__get_IPSR</a> (void)</td></tr>
 145 <tr class="memdesc:ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the IPSR register.  <br /></td></tr>
 146 <tr class="separator:ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8"><td class="memSeparator" colspan="2">&#160;</td></tr>
 147 <tr class="memitem:ga811c0012221ee918a75111ca84c4d5e7"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga811c0012221ee918a75111ca84c4d5e7">__get_APSR</a> (void)</td></tr>
 148 <tr class="memdesc:ga811c0012221ee918a75111ca84c4d5e7"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the APSR register.  <br /></td></tr>
 149 <tr class="separator:ga811c0012221ee918a75111ca84c4d5e7"><td class="memSeparator" colspan="2">&#160;</td></tr>
 150 <tr class="memitem:ga732e08184154f44a617963cc65ff95bd"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga732e08184154f44a617963cc65ff95bd">__get_xPSR</a> (void)</td></tr>
 151 <tr class="memdesc:ga732e08184154f44a617963cc65ff95bd"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the xPSR register.  <br /></td></tr>
 152 <tr class="separator:ga732e08184154f44a617963cc65ff95bd"><td class="memSeparator" colspan="2">&#160;</td></tr>
 153 <tr class="memitem:ga914dfa8eff7ca53380dd54cf1d8bebd9"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga914dfa8eff7ca53380dd54cf1d8bebd9">__get_PSP</a> (void)</td></tr>
 154 <tr class="memdesc:ga914dfa8eff7ca53380dd54cf1d8bebd9"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the PSP register.  <br /></td></tr>
 155 <tr class="separator:ga914dfa8eff7ca53380dd54cf1d8bebd9"><td class="memSeparator" colspan="2">&#160;</td></tr>
 156 <tr class="memitem:ga48e5853f417e17a8a65080f6a605b743"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga48e5853f417e17a8a65080f6a605b743">__set_PSP</a> (uint32_t topOfProcStack)</td></tr>
 157 <tr class="memdesc:ga48e5853f417e17a8a65080f6a605b743"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the PSP register.  <br /></td></tr>
 158 <tr class="separator:ga48e5853f417e17a8a65080f6a605b743"><td class="memSeparator" colspan="2">&#160;</td></tr>
 159 <tr class="memitem:gab898559392ba027814e5bbb5a98b38d2"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gab898559392ba027814e5bbb5a98b38d2">__get_MSP</a> (void)</td></tr>
 160 <tr class="memdesc:gab898559392ba027814e5bbb5a98b38d2"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the MSP register.  <br /></td></tr>
 161 <tr class="separator:gab898559392ba027814e5bbb5a98b38d2"><td class="memSeparator" colspan="2">&#160;</td></tr>
 162 <tr class="memitem:ga0bf9564ebc1613a8faba014275dac2a4"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga0bf9564ebc1613a8faba014275dac2a4">__set_MSP</a> (uint32_t topOfMainStack)</td></tr>
 163 <tr class="memdesc:ga0bf9564ebc1613a8faba014275dac2a4"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the MSP register.  <br /></td></tr>
 164 <tr class="separator:ga0bf9564ebc1613a8faba014275dac2a4"><td class="memSeparator" colspan="2">&#160;</td></tr>
 165 <tr class="memitem:ga799b5d9a2ae75e459264c8512c7c0e02"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga799b5d9a2ae75e459264c8512c7c0e02">__get_PRIMASK</a> (void)</td></tr>
 166 <tr class="memdesc:ga799b5d9a2ae75e459264c8512c7c0e02"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the PRIMASK register bit.  <br /></td></tr>
 167 <tr class="separator:ga799b5d9a2ae75e459264c8512c7c0e02"><td class="memSeparator" colspan="2">&#160;</td></tr>
 168 <tr class="memitem:ga70b4e1a6c1c86eb913fb9d6e8400156f"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f">__set_PRIMASK</a> (uint32_t priMask)</td></tr>
 169 <tr class="memdesc:ga70b4e1a6c1c86eb913fb9d6e8400156f"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the Priority Mask bit.  <br /></td></tr>
 170 <tr class="separator:ga70b4e1a6c1c86eb913fb9d6e8400156f"><td class="memSeparator" colspan="2">&#160;</td></tr>
 171 <tr class="memitem:ga32da759f46e52c95bcfbde5012260667"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga32da759f46e52c95bcfbde5012260667">__get_BASEPRI</a> (void)</td></tr>
 172 <tr class="memdesc:ga32da759f46e52c95bcfbde5012260667"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 173 <tr class="separator:ga32da759f46e52c95bcfbde5012260667"><td class="memSeparator" colspan="2">&#160;</td></tr>
 174 <tr class="memitem:ga360c73eb7ffb16088556f9278953b882"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882">__set_BASEPRI</a> (uint32_t basePri)</td></tr>
 175 <tr class="memdesc:ga360c73eb7ffb16088556f9278953b882"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 176 <tr class="separator:ga360c73eb7ffb16088556f9278953b882"><td class="memSeparator" colspan="2">&#160;</td></tr>
 177 <tr class="memitem:ga62fa63d39cf22df348857d5f44ab64d9"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga62fa63d39cf22df348857d5f44ab64d9">__set_BASEPRI_MAX</a> (uint32_t basePri)</td></tr>
 178 <tr class="memdesc:ga62fa63d39cf22df348857d5f44ab64d9"><td class="mdescLeft">&#160;</td><td class="mdescRight">Increase the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 179 <tr class="separator:ga62fa63d39cf22df348857d5f44ab64d9"><td class="memSeparator" colspan="2">&#160;</td></tr>
 180 <tr class="memitem:gaa78e4e6bf619a65e9f01b4af13fed3a8"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gaa78e4e6bf619a65e9f01b4af13fed3a8">__get_FAULTMASK</a> (void)</td></tr>
 181 <tr class="memdesc:gaa78e4e6bf619a65e9f01b4af13fed3a8"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 182 <tr class="separator:gaa78e4e6bf619a65e9f01b4af13fed3a8"><td class="memSeparator" colspan="2">&#160;</td></tr>
 183 <tr class="memitem:gaa5587cc09031053a40a35c14ec36078a"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a">__set_FAULTMASK</a> (uint32_t faultMask)</td></tr>
 184 <tr class="memdesc:gaa5587cc09031053a40a35c14ec36078a"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 185 <tr class="separator:gaa5587cc09031053a40a35c14ec36078a"><td class="memSeparator" colspan="2">&#160;</td></tr>
 186 <tr class="memitem:gad6d7eca9ddd1d9072dd7b020cfe64905"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gad6d7eca9ddd1d9072dd7b020cfe64905">__get_FPSCR</a> (void)</td></tr>
 187 <tr class="memdesc:gad6d7eca9ddd1d9072dd7b020cfe64905"><td class="mdescLeft">&#160;</td><td class="mdescRight">Read the FPSCR register [only Cortex-M4 and Cortex-M7].  <br /></td></tr>
 188 <tr class="separator:gad6d7eca9ddd1d9072dd7b020cfe64905"><td class="memSeparator" colspan="2">&#160;</td></tr>
 189 <tr class="memitem:ga6f26bd75ca7e3247f27b272acc10536b"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga6f26bd75ca7e3247f27b272acc10536b">__set_FPSCR</a> (uint32_t fpscr)</td></tr>
 190 <tr class="memdesc:ga6f26bd75ca7e3247f27b272acc10536b"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set the FPSC register [only for Cortex-M4 and Cortex-M7].  <br /></td></tr>
 191 <tr class="separator:ga6f26bd75ca7e3247f27b272acc10536b"><td class="memSeparator" colspan="2">&#160;</td></tr>
 192 <tr class="memitem:ga0f98dfbd252b89d12564472dbeba9c27"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga0f98dfbd252b89d12564472dbeba9c27">__enable_irq</a> (void)</td></tr>
 193 <tr class="memdesc:ga0f98dfbd252b89d12564472dbeba9c27"><td class="mdescLeft">&#160;</td><td class="mdescRight">Globally enables interrupts and configurable fault handlers.  <br /></td></tr>
 194 <tr class="separator:ga0f98dfbd252b89d12564472dbeba9c27"><td class="memSeparator" colspan="2">&#160;</td></tr>
 195 <tr class="memitem:gaeb8e5f7564a8ea23678fe3c987b04013"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gaeb8e5f7564a8ea23678fe3c987b04013">__disable_irq</a> (void)</td></tr>
 196 <tr class="memdesc:gaeb8e5f7564a8ea23678fe3c987b04013"><td class="mdescLeft">&#160;</td><td class="mdescRight">Globally disables interrupts and configurable fault handlers.  <br /></td></tr>
 197 <tr class="separator:gaeb8e5f7564a8ea23678fe3c987b04013"><td class="memSeparator" colspan="2">&#160;</td></tr>
 198 <tr class="memitem:ga6575d37863cec5d334864f93b5b783bf"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga6575d37863cec5d334864f93b5b783bf">__enable_fault_irq</a> (void)</td></tr>
 199 <tr class="memdesc:ga6575d37863cec5d334864f93b5b783bf"><td class="mdescLeft">&#160;</td><td class="mdescRight">Enables interrupts and all fault handlers [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 200 <tr class="separator:ga6575d37863cec5d334864f93b5b783bf"><td class="memSeparator" colspan="2">&#160;</td></tr>
 201 <tr class="memitem:ga9d174f979b2f76fdb3228a9b338fd939"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga9d174f979b2f76fdb3228a9b338fd939">__disable_fault_irq</a> (void)</td></tr>
 202 <tr class="memdesc:ga9d174f979b2f76fdb3228a9b338fd939"><td class="mdescLeft">&#160;</td><td class="mdescRight">Disables interrupts and all fault handlers [not for Cortex-M0, Cortex-M0+, or SC000].  <br /></td></tr>
 203 <tr class="separator:ga9d174f979b2f76fdb3228a9b338fd939"><td class="memSeparator" colspan="2">&#160;</td></tr>
 204 <tr class="memitem:ga8b226929264e903c7019e326b42bef47"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga8b226929264e903c7019e326b42bef47">__get_PSPLIM</a> (void)</td></tr>
 205 <tr class="memdesc:ga8b226929264e903c7019e326b42bef47"><td class="mdescLeft">&#160;</td><td class="mdescRight">Get Process Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence zero is returned always in non-secure mode.  <br /></td></tr>
 206 <tr class="separator:ga8b226929264e903c7019e326b42bef47"><td class="memSeparator" colspan="2">&#160;</td></tr>
 207 <tr class="memitem:ga4348d14fc5eefbfd34ab8c51be44a81b"><td class="memItemLeft" align="right" valign="top">void&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga4348d14fc5eefbfd34ab8c51be44a81b">__set_PSPLIM</a> (uint32_t ProcStackPtrLimit)</td></tr>
 208 <tr class="memdesc:ga4348d14fc5eefbfd34ab8c51be44a81b"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set Process Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence the write is silently ignored in non-secure mode.  <br /></td></tr>
 209 <tr class="separator:ga4348d14fc5eefbfd34ab8c51be44a81b"><td class="memSeparator" colspan="2">&#160;</td></tr>
 210 <tr class="memitem:gaf39856ca50fc88cf459031b44eb2521c"><td class="memItemLeft" align="right" valign="top">uint32_t&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#gaf39856ca50fc88cf459031b44eb2521c">__get_MSPLIM</a> (void)</td></tr>
 211 <tr class="memdesc:gaf39856ca50fc88cf459031b44eb2521c"><td class="mdescLeft">&#160;</td><td class="mdescRight">Get Main Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence zero is returned always in non-secure mode.  <br /></td></tr>
 212 <tr class="separator:gaf39856ca50fc88cf459031b44eb2521c"><td class="memSeparator" colspan="2">&#160;</td></tr>
 213 <tr class="memitem:ga6809a07c5cb7410e361f3fba57f72172"><td class="memItemLeft" align="right" valign="top">&#160;</td><td class="memItemRight" valign="bottom"><a class="el" href="group__Core__Register__gr.html#ga6809a07c5cb7410e361f3fba57f72172">__set_MSPLIM</a> (uint32_t MainStackPtrLimit)</td></tr>
 214 <tr class="memdesc:ga6809a07c5cb7410e361f3fba57f72172"><td class="mdescLeft">&#160;</td><td class="mdescRight">Set Main Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence the write is silently ignored in non-secure mode.  <br /></td></tr>
 215 <tr class="separator:ga6809a07c5cb7410e361f3fba57f72172"><td class="memSeparator" colspan="2">&#160;</td></tr>
 216 </table>
 217 <a name="details" id="details"></a><h2 class="groupheader">Description</h2>
 218 <p>Functions to access the Cortex-M core registers. </p>
 219 <p>The following functions provide access to Cortex-M core registers. </p>
 220 <h2 class="groupheader">Function Documentation</h2>
 221 <a id="ga9d174f979b2f76fdb3228a9b338fd939" name="ga9d174f979b2f76fdb3228a9b338fd939"></a>
 222 <h2 class="memtitle"><span class="permalink"><a href="#ga9d174f979b2f76fdb3228a9b338fd939">&#9670;&#160;</a></span>__disable_fault_irq()</h2>
 223
 224 <div class="memitem">
 225 <div class="memproto">
 226       <table class="memname">
 227         <tr>
 228           <td class="memname">void __disable_fault_irq </td>
 229           <td>(</td>
 230           <td class="paramtype">void&#160;</td>
 231           <td class="paramname"></td><td>)</td>
 232           <td></td>
 233         </tr>
 234       </table>
 235 </div><div class="memdoc">
 236
 237 <p>Disables interrupts and all fault handlers [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 238 <p>The function disables interrupts and all fault handlers by setting FAULTMASK. The function uses the instruction <b>CPSID f</b>.</p>
 239 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 240 <li>not for Cortex-M0, Cortex-M0+, or SC000.</li>
 241 <li>Can be executed in privileged mode only.</li>
 242 <li>An interrupt can enter pending state even if it is disabled. Disabling an interrupt only prevents the processor from taking that interrupt.</li>
 243 </ul>
 244 </dd></dl>
 245 <dl class="section see"><dt>See also</dt><dd><ul>
 246 <li><a class="el" href="group__Core__Register__gr.html#ga6575d37863cec5d334864f93b5b783bf">__enable_fault_irq</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a>; <a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a" title="Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_FAULTMASK</a> </li>
 247 </ul>
 248 </dd></dl>
 249
 250 </div>
 251 </div>
 252 <a id="gaeb8e5f7564a8ea23678fe3c987b04013" name="gaeb8e5f7564a8ea23678fe3c987b04013"></a>
 253 <h2 class="memtitle"><span class="permalink"><a href="#gaeb8e5f7564a8ea23678fe3c987b04013">&#9670;&#160;</a></span>__disable_irq()</h2>
 254
 255 <div class="memitem">
 256 <div class="memproto">
 257       <table class="memname">
 258         <tr>
 259           <td class="memname">void __disable_irq </td>
 260           <td>(</td>
 261           <td class="paramtype">void&#160;</td>
 262           <td class="paramname"></td><td>)</td>
 263           <td></td>
 264         </tr>
 265       </table>
 266 </div><div class="memdoc">
 267
 268 <p>Globally disables interrupts and configurable fault handlers. </p>
 269 <p>The function disables interrupts and all configurable fault handlers by setting PRIMASK. The function uses the instruction <b>CPSID i</b>.</p>
 270 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 271 <li>Can be executed in privileged mode only.</li>
 272 <li>An interrupt can enter pending state even if it is disabled. Disabling an interrupt only prevents the processor from taking that interrupt.</li>
 273 </ul>
 274 </dd></dl>
 275 <dl class="section see"><dt>See also</dt><dd><ul>
 276 <li><a class="el" href="group__Core__Register__gr.html#ga0f98dfbd252b89d12564472dbeba9c27">__enable_irq</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a>; <a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f" title="Set the Priority Mask bit.">__set_PRIMASK</a> </li>
 277 </ul>
 278 </dd></dl>
 279
 280 </div>
 281 </div>
 282 <a id="ga6575d37863cec5d334864f93b5b783bf" name="ga6575d37863cec5d334864f93b5b783bf"></a>
 283 <h2 class="memtitle"><span class="permalink"><a href="#ga6575d37863cec5d334864f93b5b783bf">&#9670;&#160;</a></span>__enable_fault_irq()</h2>
 284
 285 <div class="memitem">
 286 <div class="memproto">
 287       <table class="memname">
 288         <tr>
 289           <td class="memname">void __enable_fault_irq </td>
 290           <td>(</td>
 291           <td class="paramtype">void&#160;</td>
 292           <td class="paramname"></td><td>)</td>
 293           <td></td>
 294         </tr>
 295       </table>
 296 </div><div class="memdoc">
 297
 298 <p>Enables interrupts and all fault handlers [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 299 <p>The function enables interrupts and all fault handlers by clearing FAULTMASK. The function uses the instruction <b>CPSIE f</b>.</p>
 300 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 301 <li>not for Cortex-M0, Cortex-M0+, or SC000.</li>
 302 <li>Can be executed in privileged mode only.</li>
 303 </ul>
 304 </dd></dl>
 305 <dl class="section see"><dt>See also</dt><dd><ul>
 306 <li><a class="el" href="group__Core__Register__gr.html#ga9d174f979b2f76fdb3228a9b338fd939">__disable_fault_irq</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a>; <a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a" title="Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_FAULTMASK</a> </li>
 307 </ul>
 308 </dd></dl>
 309
 310 </div>
 311 </div>
 312 <a id="ga0f98dfbd252b89d12564472dbeba9c27" name="ga0f98dfbd252b89d12564472dbeba9c27"></a>
 313 <h2 class="memtitle"><span class="permalink"><a href="#ga0f98dfbd252b89d12564472dbeba9c27">&#9670;&#160;</a></span>__enable_irq()</h2>
 314
 315 <div class="memitem">
 316 <div class="memproto">
 317       <table class="memname">
 318         <tr>
 319           <td class="memname">void __enable_irq </td>
 320           <td>(</td>
 321           <td class="paramtype">void&#160;</td>
 322           <td class="paramname"></td><td>)</td>
 323           <td></td>
 324         </tr>
 325       </table>
 326 </div><div class="memdoc">
 327
 328 <p>Globally enables interrupts and configurable fault handlers. </p>
 329 <p>The function enables interrupts and all configurable fault handlers by clearing PRIMASK. The function uses the instruction <b>CPSIE i</b>.</p>
 330 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 331 <li>Can be executed in privileged mode only.</li>
 332 </ul>
 333 </dd></dl>
 334 <dl class="section see"><dt>See also</dt><dd><ul>
 335 <li><a class="el" href="group__Core__Register__gr.html#gaeb8e5f7564a8ea23678fe3c987b04013">__disable_irq</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a>; <a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f" title="Set the Priority Mask bit.">__set_PRIMASK</a> </li>
 336 </ul>
 337 </dd></dl>
 338
 339 </div>
 340 </div>
 341 <a id="ga811c0012221ee918a75111ca84c4d5e7" name="ga811c0012221ee918a75111ca84c4d5e7"></a>
 342 <h2 class="memtitle"><span class="permalink"><a href="#ga811c0012221ee918a75111ca84c4d5e7">&#9670;&#160;</a></span>__get_APSR()</h2>
 343
 344 <div class="memitem">
 345 <div class="memproto">
 346       <table class="memname">
 347         <tr>
 348           <td class="memname">uint32_t __get_APSR </td>
 349           <td>(</td>
 350           <td class="paramtype">void&#160;</td>
 351           <td class="paramname"></td><td>)</td>
 352           <td></td>
 353         </tr>
 354       </table>
 355 </div><div class="memdoc">
 356
 357 <p>Read the APSR register. </p>
 358 <p>The function reads the Application Program Status Register (APSR) using the instruction <b>MRS</b>. <br  />
 359 <br  />
 360 The APSR contains the current state of the condition flags from instructions executed previously. The APSR is essential for controlling conditional branches. The following flags are used:</p>
 361 <ul>
 362 <li><b>N</b> (APSR[31]) (Negative flag)<ul>
 363 <li>=1 The instruction result has a negative value (when interpreted as signed integer).</li>
 364 <li>=0 The instruction result has a positive value or equal zero. <br  />
 365 <br  />
 366 </li>
 367 </ul>
 368 </li>
 369 <li><b>Z</b> (APSR[30]) (Zero flag)<ul>
 370 <li>=1 The instruction result is zero. Or, after a compare instruction, when the two values are the same. <br  />
 371 <br  />
 372 </li>
 373 </ul>
 374 </li>
 375 <li><b>C</b> (APSR[29]) (Carry or borrow flag)<ul>
 376 <li>=1 For unsigned additions, if an unsigned overflow occurred.</li>
 377 <li>=<em>inverse of borrow output status</em> For unsigned subtract operations. <br  />
 378 <br  />
 379 </li>
 380 </ul>
 381 </li>
 382 <li><b>V</b> (APSR[28]) (Overflow flag)<ul>
 383 <li>=1 A signed overflow occurred (for signed additions or subtractions). <br  />
 384 <br  />
 385 </li>
 386 </ul>
 387 </li>
 388 <li><b>Q</b> (APSR[27]) (DSP overflow or saturation flag) [not Cortex-M0]<ul>
 389 <li>This flag is a <em>sticky</em> flag. Saturating and certain multiplying instructions can set the flag, but cannot clear it.</li>
 390 <li>=1 When saturation or an overflow occurred. <br  />
 391 <br  />
 392 </li>
 393 </ul>
 394 </li>
 395 <li><b>GE</b> (APSR[19:16]) (Greater than or Equal flags) [not Cortex-M0]<ul>
 396 <li>Can be set by the parallel add and subtract instructions.</li>
 397 <li>Are used by the <code>SEL</code> instruction to perform byte-based selection from two registers.</li>
 398 </ul>
 399 </li>
 400 </ul>
 401 <dl class="section return"><dt>Returns</dt><dd>APSR register value</dd></dl>
 402 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 403 <ul>
 404 <li>Some instructions update all flags; some instructions update a subset of the flags.</li>
 405 <li>If a flag is not updated, the original value is preserved.</li>
 406 <li>Conditional instructions that are not executed have no effect on the flags.</li>
 407 <li>The CMSIS does not provide a function to update this register.</li>
 408 </ul>
 409 </dd></dl>
 410 <dl class="section see"><dt>See also</dt><dd><br  />
 411 <ul>
 412 <li><a class="el" href="group__Core__Register__gr.html#ga732e08184154f44a617963cc65ff95bd">__get_xPSR</a>; <a class="el" href="unionAPSR__Type.html" title="Union type to access the Application Program Status Register (APSR).">APSR_Type</a></li>
 413 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 414 </ul>
 415 </dd></dl>
 416
 417 </div>
 418 </div>
 419 <a id="ga32da759f46e52c95bcfbde5012260667" name="ga32da759f46e52c95bcfbde5012260667"></a>
 420 <h2 class="memtitle"><span class="permalink"><a href="#ga32da759f46e52c95bcfbde5012260667">&#9670;&#160;</a></span>__get_BASEPRI()</h2>
 421
 422 <div class="memitem">
 423 <div class="memproto">
 424       <table class="memname">
 425         <tr>
 426           <td class="memname">uint32_t __get_BASEPRI </td>
 427           <td>(</td>
 428           <td class="paramtype">void&#160;</td>
 429           <td class="paramname"></td><td>)</td>
 430           <td></td>
 431         </tr>
 432       </table>
 433 </div><div class="memdoc">
 434
 435 <p>Read the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 436 <p>The function returns the Base Priority Mask register (BASEPRI) using the instruction <b>MRS</b>. <br  />
 437 <br  />
 438 BASEPRI defines the minimum priority for exception processing. When BASEPRI is set to a non-zero value, it prevents the activation of all exceptions with the same or lower priority level as the BASEPRI value.</p>
 439 <dl class="section return"><dt>Returns</dt><dd>BASEPRI register value</dd></dl>
 440 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 441 <ul>
 442 <li>Not for Cortex-M0, Cortex-M0+, or SC000.</li>
 443 </ul>
 444 </dd></dl>
 445 <dl class="section see"><dt>See also</dt><dd><ul>
 446 <li><a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#ga62fa63d39cf22df348857d5f44ab64d9" title="Increase the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI_MAX</a>; <a class="el" href="group__Core__Register__gr.html#gaa78e4e6bf619a65e9f01b4af13fed3a8" title="Read the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__get_FAULTMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga799b5d9a2ae75e459264c8512c7c0e02" title="Read the PRIMASK register bit.">__get_PRIMASK</a></li>
 447 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 448 </ul>
 449 </dd></dl>
 450
 451 </div>
 452 </div>
 453 <a id="ga963cf236b73219ce78e965deb01b81a7" name="ga963cf236b73219ce78e965deb01b81a7"></a>
 454 <h2 class="memtitle"><span class="permalink"><a href="#ga963cf236b73219ce78e965deb01b81a7">&#9670;&#160;</a></span>__get_CONTROL()</h2>
 455
 456 <div class="memitem">
 457 <div class="memproto">
 458       <table class="memname">
 459         <tr>
 460           <td class="memname">uint32_t __get_CONTROL </td>
 461           <td>(</td>
 462           <td class="paramtype">void&#160;</td>
 463           <td class="paramname"></td><td>)</td>
 464           <td></td>
 465         </tr>
 466       </table>
 467 </div><div class="memdoc">
 468
 469 <p>Read the CONTROL register. </p>
 470 <p>The function reads the CONTROL register value using the instruction <b>MRS</b>. <br  />
 471 <br  />
 472 The CONTROL register controls the stack used and the privilege level for software execution when the processor is in thread mode and, if implemented, indicates whether the FPU state is active. This register uses the following bits: <br  />
 473 </p><ul>
 474 <li><b>CONTROL</b>[2] [only Cortex-M4 and Cortex-M7]<ul>
 475 <li>=0 FPU not active</li>
 476 <li>=1 FPU active <br  />
 477 <br  />
 478 </li>
 479 </ul>
 480 </li>
 481 <li><b>CONTROL</b>[1]<ul>
 482 <li>=0 In handler mode - MSP is selected. No alternate stack possible for handler mode.</li>
 483 <li>=0 In thread mode - Default stack pointer MSP is used.</li>
 484 <li>=1 In thread mode - Alternate stack pointer PSP is used. <br  />
 485 <br  />
 486 </li>
 487 </ul>
 488 </li>
 489 <li><b>CONTROL</b>[0] [not Cortex-M0]<ul>
 490 <li>=0 In thread mode and privileged state.</li>
 491 <li>=1 In thread mode and user state.</li>
 492 </ul>
 493 </li>
 494 </ul>
 495 <dl class="section return"><dt>Returns</dt><dd>CONTROL register value</dd></dl>
 496 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 497 <ul>
 498 <li>The processor can be in user state or privileged state when running in thread mode.</li>
 499 <li>Exception handlers always run in privileged state.</li>
 500 <li>On reset, the processor is in thread mode with privileged access rights.</li>
 501 </ul>
 502 </dd></dl>
 503 <dl class="section see"><dt>See also</dt><dd><br  />
 504 <ul>
 505 <li><a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c">__set_CONTROL</a>; <a class="el" href="unionCONTROL__Type.html" title="Union type to access the Control Registers (CONTROL).">CONTROL_Type</a></li>
 506 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 507 </ul>
 508 </dd></dl>
 509
 510 </div>
 511 </div>
 512 <a id="gaa78e4e6bf619a65e9f01b4af13fed3a8" name="gaa78e4e6bf619a65e9f01b4af13fed3a8"></a>
 513 <h2 class="memtitle"><span class="permalink"><a href="#gaa78e4e6bf619a65e9f01b4af13fed3a8">&#9670;&#160;</a></span>__get_FAULTMASK()</h2>
 514
 515 <div class="memitem">
 516 <div class="memproto">
 517       <table class="memname">
 518         <tr>
 519           <td class="memname">uint32_t __get_FAULTMASK </td>
 520           <td>(</td>
 521           <td class="paramtype">void&#160;</td>
 522           <td class="paramname"></td><td>)</td>
 523           <td></td>
 524         </tr>
 525       </table>
 526 </div><div class="memdoc">
 527
 528 <p>Read the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 529 <p>The function reads the Fault Mask register (FAULTMASK) value using the instruction <b>MRS</b>. <br  />
 530 <br  />
 531 FAULTMASK prevents activation of all exceptions except for the Non-Maskable Interrupt (NMI).</p>
 532 <dl class="section return"><dt>Returns</dt><dd>FAULTMASK register value</dd></dl>
 533 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 534 <ul>
 535 <li>not for Cortex-M0, Cortex-M0+, or SC000.</li>
 536 <li>Is cleared automatically upon exiting the exception handler, except when returning from the NMI handler.</li>
 537 </ul>
 538 </dd></dl>
 539 <dl class="section see"><dt>See also</dt><dd><ul>
 540 <li><a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a">__set_FAULTMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga32da759f46e52c95bcfbde5012260667" title="Read the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__get_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#ga799b5d9a2ae75e459264c8512c7c0e02" title="Read the PRIMASK register bit.">__get_PRIMASK</a></li>
 541 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 542 </ul>
 543 </dd></dl>
 544
 545 </div>
 546 </div>
 547 <a id="gad6d7eca9ddd1d9072dd7b020cfe64905" name="gad6d7eca9ddd1d9072dd7b020cfe64905"></a>
 548 <h2 class="memtitle"><span class="permalink"><a href="#gad6d7eca9ddd1d9072dd7b020cfe64905">&#9670;&#160;</a></span>__get_FPSCR()</h2>
 549
 550 <div class="memitem">
 551 <div class="memproto">
 552       <table class="memname">
 553         <tr>
 554           <td class="memname">uint32_t __get_FPSCR </td>
 555           <td>(</td>
 556           <td class="paramtype">void&#160;</td>
 557           <td class="paramname"></td><td>)</td>
 558           <td></td>
 559         </tr>
 560       </table>
 561 </div><div class="memdoc">
 562
 563 <p>Read the FPSCR register [only Cortex-M4 and Cortex-M7]. </p>
 564 <p>The function reads the Floating-Point Status Control Register (FPSCR) value. <br  />
 565 <br  />
 566 FPSCR provides all necessary User level controls of the floating-point system.</p>
 567 <dl class="section return"><dt>Returns</dt><dd><br  />
 568 <ul>
 569 <li>FPSCR register value, when __FPU_PRESENT=1</li>
 570 <li>=0, when __FPU_PRESENT=0</li>
 571 </ul>
 572 </dd></dl>
 573 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 574 <li>Only for Cortex-M4 and Cortex-M7.</li>
 575 </ul>
 576 </dd></dl>
 577 <dl class="section see"><dt>See also</dt><dd><ul>
 578 <li><a class="el" href="group__Core__Register__gr.html#ga6f26bd75ca7e3247f27b272acc10536b">__set_FPSCR</a></li>
 579 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 580 </ul>
 581 </dd></dl>
 582
 583 </div>
 584 </div>
 585 <a id="ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8" name="ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8"></a>
 586 <h2 class="memtitle"><span class="permalink"><a href="#ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8">&#9670;&#160;</a></span>__get_IPSR()</h2>
 587
 588 <div class="memitem">
 589 <div class="memproto">
 590       <table class="memname">
 591         <tr>
 592           <td class="memname">uint32_t __get_IPSR </td>
 593           <td>(</td>
 594           <td class="paramtype">void&#160;</td>
 595           <td class="paramname"></td><td>)</td>
 596           <td></td>
 597         </tr>
 598       </table>
 599 </div><div class="memdoc">
 600
 601 <p>Read the IPSR register. </p>
 602 <p>The function reads the Interrupt Program Status Register (IPSR) using the instruction <b>MRS</b>. <br  />
 603 <br  />
 604 The ISPR contains the exception type number of the current Interrupt Service Routine (ISR). Each exception has an associated unique IRQn number. The following bits are used:</p>
 605 <ul>
 606 <li><b>ISR_NUMBER</b> (IPSR[8:0])<ul>
 607 <li>= 0 Thread mode</li>
 608 <li>= 1 Reserved</li>
 609 <li>= 2 NMI</li>
 610 <li>= 3 HardFault</li>
 611 <li>= 4 MemManage</li>
 612 <li>= 5 BusFault</li>
 613 <li>= 6 UsageFault</li>
 614 <li>= 7 SecureFault</li>
 615 <li>= 8-10 Reserved</li>
 616 <li>= 11 SVC</li>
 617 <li>= 12 Reserved for Debug</li>
 618 <li>= 13 Reserved</li>
 619 <li>= 14 PendSV</li>
 620 <li>= 15 SysTick</li>
 621 <li>= 16 IRQ0</li>
 622 <li>...</li>
 623 <li>= n+15 IRQ(n-1)</li>
 624 </ul>
 625 </li>
 626 </ul>
 627 <dl class="section return"><dt>Returns</dt><dd>ISPR register value</dd></dl>
 628 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 629 <ul>
 630 <li>This register is read-only.</li>
 631 </ul>
 632 </dd></dl>
 633 <dl class="section see"><dt>See also</dt><dd><br  />
 634 <ul>
 635 <li><a class="el" href="group__Core__Register__gr.html#ga732e08184154f44a617963cc65ff95bd">__get_xPSR</a>; <a class="el" href="unionIPSR__Type.html" title="Union type to access the Interrupt Program Status Register (IPSR).">IPSR_Type</a></li>
 636 <li><a class="el" href="group__NVIC__gr.html">Interrupts and Exceptions (NVIC)</a></li>
 637 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 638 </ul>
 639 </dd></dl>
 640
 641 </div>
 642 </div>
 643 <a id="gab898559392ba027814e5bbb5a98b38d2" name="gab898559392ba027814e5bbb5a98b38d2"></a>
 644 <h2 class="memtitle"><span class="permalink"><a href="#gab898559392ba027814e5bbb5a98b38d2">&#9670;&#160;</a></span>__get_MSP()</h2>
 645
 646 <div class="memitem">
 647 <div class="memproto">
 648       <table class="memname">
 649         <tr>
 650           <td class="memname">uint32_t __get_MSP </td>
 651           <td>(</td>
 652           <td class="paramtype">void&#160;</td>
 653           <td class="paramname"></td><td>)</td>
 654           <td></td>
 655         </tr>
 656       </table>
 657 </div><div class="memdoc">
 658
 659 <p>Read the MSP register. </p>
 660 <p>The function reads the Main Stack Pointer (MSP) value using the instruction <b>MRS</b>. <br  />
 661 <br  />
 662 Physically two different stack pointers (SP) exist:</p><ul>
 663 <li>The Main Stack Pointer (MSP) is the default stack pointer after reset. It is also used when running exception handlers (handler mode).</li>
 664 <li>The Process Stack Pointer (PSP), which can be used only in thread mode.</li>
 665 </ul>
 666 <p>Register R13 banks the SP. The SP selection is determined by the bit[1] of the CONTROL register:</p><ul>
 667 <li>=0 MSP is the current stack pointer. This is also the default SP. The initial value is loaded from the first 32-bit word of the vector table from the program memory.</li>
 668 <li>=1 PSP is the current stack pointer. The initial value is undefined.</li>
 669 </ul>
 670 <dl class="section return"><dt>Returns</dt><dd>MSP Register value</dd></dl>
 671 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 672 <li>Only one of the two SPs is visible at a time.</li>
 673 <li>For many applications, the system can completely rely on the MSP.</li>
 674 <li>The PSP is normally used in designs with an OS where the stack memory for OS Kernel must be separated from the application code. <br  />
 675 </li>
 676 </ul>
 677 </dd></dl>
 678 <dl class="section see"><dt>See also</dt><dd><ul>
 679 <li><a class="el" href="group__Core__Register__gr.html#ga0bf9564ebc1613a8faba014275dac2a4">__set_MSP</a>; <a class="el" href="group__Core__Register__gr.html#ga914dfa8eff7ca53380dd54cf1d8bebd9" title="Read the PSP register.">__get_PSP</a>; <a class="el" href="group__Core__Register__gr.html#ga963cf236b73219ce78e965deb01b81a7" title="Read the CONTROL register.">__get_CONTROL</a></li>
 680 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 681 </ul>
 682 </dd></dl>
 683
 684 </div>
 685 </div>
 686 <a id="gaf39856ca50fc88cf459031b44eb2521c" name="gaf39856ca50fc88cf459031b44eb2521c"></a>
 687 <h2 class="memtitle"><span class="permalink"><a href="#gaf39856ca50fc88cf459031b44eb2521c">&#9670;&#160;</a></span>__get_MSPLIM()</h2>
 688
 689 <div class="memitem">
 690 <div class="memproto">
 691       <table class="memname">
 692         <tr>
 693           <td class="memname">uint32_t __get_MSPLIM </td>
 694           <td>(</td>
 695           <td class="paramtype">void&#160;</td>
 696           <td class="paramname"></td><td>)</td>
 697           <td></td>
 698         </tr>
 699       </table>
 700 </div><div class="memdoc">
 701
 702 <p>Get Main Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence zero is returned always in non-secure mode. </p>
 703 <p>Returns the current value of the Main Stack Pointer Limit (MSPLIM). </p><dl class="section return"><dt>Returns</dt><dd>MSPLIM Register value </dd></dl>
 704 <dl class="section note"><dt>Note</dt><dd>Only available for Armv8-M Architecture. </dd></dl>
 705
 706 </div>
 707 </div>
 708 <a id="ga799b5d9a2ae75e459264c8512c7c0e02" name="ga799b5d9a2ae75e459264c8512c7c0e02"></a>
 709 <h2 class="memtitle"><span class="permalink"><a href="#ga799b5d9a2ae75e459264c8512c7c0e02">&#9670;&#160;</a></span>__get_PRIMASK()</h2>
 710
 711 <div class="memitem">
 712 <div class="memproto">
 713       <table class="memname">
 714         <tr>
 715           <td class="memname">uint32_t __get_PRIMASK </td>
 716           <td>(</td>
 717           <td class="paramtype">void&#160;</td>
 718           <td class="paramname"></td><td>)</td>
 719           <td></td>
 720         </tr>
 721       </table>
 722 </div><div class="memdoc">
 723
 724 <p>Read the PRIMASK register bit. </p>
 725 <p>The function reads the Priority Mask register (PRIMASK) value using the instruction <b>MRS</b>. <br  />
 726 <br  />
 727 PRIMASK is a 1-bit-wide interrupt mask register. When set, it blocks all interrupts apart from the non-maskable interrupt (NMI) and the hard fault exception. The PRIMASK prevents activation of all exceptions with configurable priority.</p>
 728 <dl class="section return"><dt>Returns</dt><dd>PRIMASK register value<ul>
 729 <li>=0 no effect</li>
 730 <li>=1 prevents the activation of all exceptions with configurable priority</li>
 731 </ul>
 732 </dd></dl>
 733 <dl class="section see"><dt>See also</dt><dd><ul>
 734 <li><a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f">__set_PRIMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga32da759f46e52c95bcfbde5012260667" title="Read the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__get_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gaa78e4e6bf619a65e9f01b4af13fed3a8" title="Read the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__get_FAULTMASK</a></li>
 735 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> <br  />
 736  </li>
 737 </ul>
 738 </dd></dl>
 739
 740 </div>
 741 </div>
 742 <a id="ga914dfa8eff7ca53380dd54cf1d8bebd9" name="ga914dfa8eff7ca53380dd54cf1d8bebd9"></a>
 743 <h2 class="memtitle"><span class="permalink"><a href="#ga914dfa8eff7ca53380dd54cf1d8bebd9">&#9670;&#160;</a></span>__get_PSP()</h2>
 744
 745 <div class="memitem">
 746 <div class="memproto">
 747       <table class="memname">
 748         <tr>
 749           <td class="memname">uint32_t __get_PSP </td>
 750           <td>(</td>
 751           <td class="paramtype">void&#160;</td>
 752           <td class="paramname"></td><td>)</td>
 753           <td></td>
 754         </tr>
 755       </table>
 756 </div><div class="memdoc">
 757
 758 <p>Read the PSP register. </p>
 759 <p>The function reads the Process Stack Pointer (PSP) value using the instruction <b>MRS</b>. <br  />
 760 <br  />
 761 Physically two different stack pointers (SP) exist:</p><ul>
 762 <li>The Main Stack Pointer (MSP) is the default stack pointer after reset. It is also used when running exception handlers (handler mode).</li>
 763 <li>The Process Stack Pointer (PSP), which can be used only in thread mode.</li>
 764 </ul>
 765 <p>Register R13 banks the SP. The SP selection is determined by the bit[1] of the CONTROL register:</p><ul>
 766 <li>=0 MSP is the current stack pointer. This is also the default SP. The initial value is loaded from the first 32-bit word of the vector table from the program memory.</li>
 767 <li>=1 PSP is the current stack pointer. The initial value is undefined.</li>
 768 </ul>
 769 <dl class="section return"><dt>Returns</dt><dd>PSP register value</dd></dl>
 770 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 771 <li>Only one of the two SPs is visible at a time.</li>
 772 <li>For many applications, the system can completely rely on the MSP.</li>
 773 <li>The PSP is normally used in designs with an OS where the stack memory for OS Kernel must be separated from the application code. <br  />
 774 </li>
 775 </ul>
 776 </dd></dl>
 777 <dl class="section see"><dt>See also</dt><dd><ul>
 778 <li><a class="el" href="group__Core__Register__gr.html#ga48e5853f417e17a8a65080f6a605b743">__set_PSP</a>; <a class="el" href="group__Core__Register__gr.html#gab898559392ba027814e5bbb5a98b38d2" title="Read the MSP register.">__get_MSP</a>; <a class="el" href="group__Core__Register__gr.html#ga963cf236b73219ce78e965deb01b81a7" title="Read the CONTROL register.">__get_CONTROL</a></li>
 779 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 780 </ul>
 781 </dd></dl>
 782
 783 </div>
 784 </div>
 785 <a id="ga8b226929264e903c7019e326b42bef47" name="ga8b226929264e903c7019e326b42bef47"></a>
 786 <h2 class="memtitle"><span class="permalink"><a href="#ga8b226929264e903c7019e326b42bef47">&#9670;&#160;</a></span>__get_PSPLIM()</h2>
 787
 788 <div class="memitem">
 789 <div class="memproto">
 790       <table class="memname">
 791         <tr>
 792           <td class="memname">uint32_t __get_PSPLIM </td>
 793           <td>(</td>
 794           <td class="paramtype">void&#160;</td>
 795           <td class="paramname"></td><td>)</td>
 796           <td></td>
 797         </tr>
 798       </table>
 799 </div><div class="memdoc">
 800
 801 <p>Get Process Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence zero is returned always in non-secure mode. </p>
 802 <p>Returns the current value of the Process Stack Pointer Limit (PSPLIM). </p><dl class="section return"><dt>Returns</dt><dd>PSPLIM Register value </dd></dl>
 803 <dl class="section note"><dt>Note</dt><dd>Only available for Armv8-M Architecture. </dd></dl>
 804
 805 </div>
 806 </div>
 807 <a id="ga732e08184154f44a617963cc65ff95bd" name="ga732e08184154f44a617963cc65ff95bd"></a>
 808 <h2 class="memtitle"><span class="permalink"><a href="#ga732e08184154f44a617963cc65ff95bd">&#9670;&#160;</a></span>__get_xPSR()</h2>
 809
 810 <div class="memitem">
 811 <div class="memproto">
 812       <table class="memname">
 813         <tr>
 814           <td class="memname">uint32_t __get_xPSR </td>
 815           <td>(</td>
 816           <td class="paramtype">void&#160;</td>
 817           <td class="paramname"></td><td>)</td>
 818           <td></td>
 819         </tr>
 820       </table>
 821 </div><div class="memdoc">
 822
 823 <p>Read the xPSR register. </p>
 824 <p>The function reads the combined Program Status Register (xPSR) using the instruction <b>MRS</b>. <br  />
 825 <br  />
 826 xPSR provides information about program execution and the APSR flags. It consists of the following PSRs: </p><ul>
 827 <li>Application Program Status Register (APSR) </li>
 828 <li>Interrupt Program Status Register (IPSR) </li>
 829 <li>Execution Program Status Register (EPSR)</li>
 830 </ul>
 831 <p>In addition to the flags described in <a class="el" href="group__Core__Register__gr.html#ga811c0012221ee918a75111ca84c4d5e7">__get_APSR</a> and <a class="el" href="group__Core__Register__gr.html#ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8">__get_IPSR</a>, the register provides the following flags:</p><ul>
 832 <li><b>IT</b> (xPSR[26:25]) (If-Then condition instruction)<ul>
 833 <li>Contains up to four instructions following an IT instruction.</li>
 834 <li>Each instruction in the block is conditional.</li>
 835 <li>The conditions for the instructions are either all the same, or some can be the inverse of others. <br  />
 836 <br  />
 837 </li>
 838 </ul>
 839 </li>
 840 <li><b>T</b> (xPSR[24]) (Thumb bit)<ul>
 841 <li>=1 Indicates that that the processor is in Thumb state.</li>
 842 <li>=0 Attempting to execute instructions when the T bit is 0 results in a fault or lockup.</li>
 843 <li>The conditions for the instructions are either all the same, or some can be the inverse of others.</li>
 844 </ul>
 845 </li>
 846 </ul>
 847 <dl class="section return"><dt>Returns</dt><dd>xPSR register value</dd></dl>
 848 <dl class="section remark"><dt>Remarks</dt><dd><ul>
 849 <li>The CMSIS does not provide functions that access EPSR.</li>
 850 </ul>
 851 </dd></dl>
 852 <dl class="section see"><dt>See also</dt><dd><br  />
 853 <ul>
 854 <li><a class="el" href="group__Core__Register__gr.html#ga811c0012221ee918a75111ca84c4d5e7">__get_APSR</a>; <a class="el" href="group__Core__Register__gr.html#ga2c32fc5c7f8f07fb3d436c6f6fe4e8c8" title="Read the IPSR register.">__get_IPSR</a>; <a class="el" href="unionxPSR__Type.html" title="Union type to access the Special-Purpose Program Status Registers (xPSR).">xPSR_Type</a></li>
 855 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 856 </ul>
 857 </dd></dl>
 858
 859 </div>
 860 </div>
 861 <a id="ga360c73eb7ffb16088556f9278953b882" name="ga360c73eb7ffb16088556f9278953b882"></a>
 862 <h2 class="memtitle"><span class="permalink"><a href="#ga360c73eb7ffb16088556f9278953b882">&#9670;&#160;</a></span>__set_BASEPRI()</h2>
 863
 864 <div class="memitem">
 865 <div class="memproto">
 866       <table class="memname">
 867         <tr>
 868           <td class="memname">void __set_BASEPRI </td>
 869           <td>(</td>
 870           <td class="paramtype">uint32_t&#160;</td>
 871           <td class="paramname"><em>basePri</em></td><td>)</td>
 872           <td></td>
 873         </tr>
 874       </table>
 875 </div><div class="memdoc">
 876
 877 <p>Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 878 <p>The function sets the Base Priority Mask register (BASEPRI) value using the instruction <b>MSR</b>. <br  />
 879 <br  />
 880 BASEPRI defines the minimum priority for exception processing. When BASEPRI is set to a non-zero value, it prevents the activation of all exceptions with the same or lower priority level as the BASEPRI value.</p>
 881 <dl class="params"><dt>Parameters</dt><dd>
 882   <table class="params">
 883     <tr><td class="paramdir">[in]</td><td class="paramname">basePri</td><td>BASEPRI value to set</td></tr>
 884   </table>
 885   </dd>
 886 </dl>
 887 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 888 <ul>
 889 <li>Not for Cortex-M0, Cortex-M0+, or SC000.</li>
 890 <li>Cannot be set in user state.</li>
 891 <li>Useful for changing the masking level or disabling the masking.</li>
 892 </ul>
 893 </dd></dl>
 894 <dl class="section see"><dt>See also</dt><dd><ul>
 895 <li><a class="el" href="group__Core__Register__gr.html#ga32da759f46e52c95bcfbde5012260667">__get_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#ga62fa63d39cf22df348857d5f44ab64d9" title="Increase the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI_MAX</a>; <a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a" title="Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_FAULTMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f" title="Set the Priority Mask bit.">__set_PRIMASK</a></li>
 896 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 897 </ul>
 898 </dd></dl>
 899
 900 </div>
 901 </div>
 902 <a id="ga62fa63d39cf22df348857d5f44ab64d9" name="ga62fa63d39cf22df348857d5f44ab64d9"></a>
 903 <h2 class="memtitle"><span class="permalink"><a href="#ga62fa63d39cf22df348857d5f44ab64d9">&#9670;&#160;</a></span>__set_BASEPRI_MAX()</h2>
 904
 905 <div class="memitem">
 906 <div class="memproto">
 907       <table class="memname">
 908         <tr>
 909           <td class="memname">void __set_BASEPRI_MAX </td>
 910           <td>(</td>
 911           <td class="paramtype">uint32_t&#160;</td>
 912           <td class="paramname"><em>basePri</em></td><td>)</td>
 913           <td></td>
 914         </tr>
 915       </table>
 916 </div><div class="memdoc">
 917
 918 <p>Increase the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
 919 <p>The function only increases the Base Priority Mask register (BASEPRI) value using the instruction <b>MSR</b>. The value is set only if BASEPRI masking is disabled, or the new value increases the BASEPRI priority level. <br  />
 920 <br  />
 921  BASEPRI defines the minimum priority for exception processing.</p>
 922 <dl class="params"><dt>Parameters</dt><dd>
 923   <table class="params">
 924     <tr><td class="paramdir">[in]</td><td class="paramname">basePri</td><td>BASEPRI value to set</td></tr>
 925   </table>
 926   </dd>
 927 </dl>
 928 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 929 <ul>
 930 <li>Not for Cortex-M0, Cortex-M0+, or SC000.</li>
 931 <li>Cannot be set in user state.</li>
 932 <li>Useful for increasing the masking level.</li>
 933 <li>Has no effect when <em>basePri</em> is lower than the current value of BASEPRI.</li>
 934 <li>Use <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882">__set_BASEPRI</a> to lower the Base Priority Mask register.</li>
 935 </ul>
 936 </dd></dl>
 937 <dl class="section see"><dt>See also</dt><dd><ul>
 938 <li><a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#ga32da759f46e52c95bcfbde5012260667" title="Read the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__get_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a" title="Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_FAULTMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f" title="Set the Priority Mask bit.">__set_PRIMASK</a></li>
 939 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
 940 </ul>
 941 </dd></dl>
 942
 943 </div>
 944 </div>
 945 <a id="gac64d37e7ff9de06437f9fb94bbab8b6c" name="gac64d37e7ff9de06437f9fb94bbab8b6c"></a>
 946 <h2 class="memtitle"><span class="permalink"><a href="#gac64d37e7ff9de06437f9fb94bbab8b6c">&#9670;&#160;</a></span>__set_CONTROL()</h2>
 947
 948 <div class="memitem">
 949 <div class="memproto">
 950       <table class="memname">
 951         <tr>
 952           <td class="memname">void __set_CONTROL </td>
 953           <td>(</td>
 954           <td class="paramtype">uint32_t&#160;</td>
 955           <td class="paramname"><em>control</em></td><td>)</td>
 956           <td></td>
 957         </tr>
 958       </table>
 959 </div><div class="memdoc">
 960
 961 <p>Set the CONTROL Register. </p>
 962 <p>The function sets the CONTROL register value using the instruction <b>MSR</b>. <br  />
 963 <br  />
 964 The CONTROL register controls the stack used and the privilege level for software execution when the processor is in thread mode and, if implemented, indicates whether the FPU state is active. This register uses the following bits: <br  />
 965 </p><ul>
 966 <li><b>CONTROL</b>[2] [only Cortex-M4 and Cortex-M7]<ul>
 967 <li>=0 FPU not active</li>
 968 <li>=1 FPU active <br  />
 969 <br  />
 970 </li>
 971 </ul>
 972 </li>
 973 <li><b>CONTROL</b>[1]<ul>
 974 <li>Writeable only when the processor is in thread mode and privileged state (CONTROL[0]=0).</li>
 975 <li>=0 In handler mode - MSP is selected. No alternate stack pointer possible for handler mode.</li>
 976 <li>=0 In thread mode - Default stack pointer MSP is used.</li>
 977 <li>=1 In thread mode - Alternate stack pointer PSP is used. <br  />
 978 <br  />
 979 </li>
 980 </ul>
 981 </li>
 982 <li><b>CONTROL</b>[0] [not writeable for Cortex-M0]<ul>
 983 <li>Writeable only when the processor is in privileged state.</li>
 984 <li>Can be used to switch the processor to user state (thread mode).</li>
 985 <li>Once in user state, trigger an interrupt and change the state to privileged in the exception handler (the only way).</li>
 986 <li>=0 In thread mode and privileged state.</li>
 987 <li>=1 In thread mode and user state.</li>
 988 </ul>
 989 </li>
 990 </ul>
 991 <dl class="params"><dt>Parameters</dt><dd>
 992   <table class="params">
 993     <tr><td class="paramdir">[in]</td><td class="paramname">control</td><td>CONTROL register value to set <br  />
 994 </td></tr>
 995   </table>
 996   </dd>
 997 </dl>
 998 <dl class="section remark"><dt>Remarks</dt><dd><br  />
 999 <ul>
1000 <li>The processor can be in user state or privileged state when running in thread mode.</li>
1001 <li>Exception handlers always run in privileged state.</li>
1002 <li>On reset, the processor is in thread mode with privileged access rights.</li>
1003 </ul>
1004 </dd></dl>
1005 <dl class="section see"><dt>See also</dt><dd><br  />
1006 <ul>
1007 <li><a class="el" href="group__Core__Register__gr.html#ga963cf236b73219ce78e965deb01b81a7">__get_CONTROL</a>; <a class="el" href="group__Core__Register__gr.html#ga48e5853f417e17a8a65080f6a605b743" title="Set the PSP register.">__set_PSP</a>; <a class="el" href="group__Core__Register__gr.html#ga0bf9564ebc1613a8faba014275dac2a4" title="Set the MSP register.">__set_MSP</a>; <a class="el" href="unionCONTROL__Type.html" title="Union type to access the Control Registers (CONTROL).">CONTROL_Type</a></li>
1008 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
1009 </ul>
1010 </dd></dl>
1011
1012 </div>
1013 </div>
1014 <a id="gaa5587cc09031053a40a35c14ec36078a" name="gaa5587cc09031053a40a35c14ec36078a"></a>
1015 <h2 class="memtitle"><span class="permalink"><a href="#gaa5587cc09031053a40a35c14ec36078a">&#9670;&#160;</a></span>__set_FAULTMASK()</h2>
1016
1017 <div class="memitem">
1018 <div class="memproto">
1019       <table class="memname">
1020         <tr>
1021           <td class="memname">void __set_FAULTMASK </td>
1022           <td>(</td>
1023           <td class="paramtype">uint32_t&#160;</td>
1024           <td class="paramname"><em>faultMask</em></td><td>)</td>
1025           <td></td>
1026         </tr>
1027       </table>
1028 </div><div class="memdoc">
1029
1030 <p>Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000]. </p>
1031 <p>The function sets the Fault Mask register (FAULTMASK) value using the instruction <b>MSR</b>. <br  />
1032 <br  />
1033 FAULTMASK prevents activation of all exceptions except for Non-Maskable Interrupt (NMI). FAULTMASK can be used to escalate a configurable fault handler (BusFault, usage fault, or memory management fault) to hard fault level without invoking a hard fault. This allows the fault handler to pretend to be the hard fault handler, with the ability to:</p><ol type="1">
1034 <li><b>Mask BusFault</b> by setting the BFHFNMIGN in the Configuration Control register. It can be used to test the bus system without causing a lockup.</li>
1035 <li><b>Bypass the MPU</b>, allowing accessing the MPU protected memory location without reprogramming the MPU to just carry out a few transfers for fixing faults.</li>
1036 </ol>
1037 <dl class="params"><dt>Parameters</dt><dd>
1038   <table class="params">
1039     <tr><td class="paramdir">[in]</td><td class="paramname">faultMask</td><td>FAULTMASK register value to set</td></tr>
1040   </table>
1041   </dd>
1042 </dl>
1043 <dl class="section remark"><dt>Remarks</dt><dd><br  />
1044 <ul>
1045 <li>not for Cortex-M0, Cortex-M0+, or SC000.</li>
1046 <li>Is cleared automatically upon exiting the exception handler, except when returning from the NMI handler.</li>
1047 <li>When set, it changes the effective current priority level to -1, so that even the hard fault handler is blocked.</li>
1048 <li>Can be used by fault handlers to change their priority to -1 to have access to some features for hard fault exceptions (see above).</li>
1049 <li>When set, lockups can still be caused by incorrect or undefined instructions, or by using SVC in the wrong priority level.</li>
1050 </ul>
1051 </dd></dl>
1052 <dl class="section see"><dt>See also</dt><dd><ul>
1053 <li><a class="el" href="group__Core__Register__gr.html#gaa78e4e6bf619a65e9f01b4af13fed3a8">__get_FAULTMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#ga70b4e1a6c1c86eb913fb9d6e8400156f" title="Set the Priority Mask bit.">__set_PRIMASK</a></li>
1054 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
1055 </ul>
1056 </dd></dl>
1057
1058 </div>
1059 </div>
1060 <a id="ga6f26bd75ca7e3247f27b272acc10536b" name="ga6f26bd75ca7e3247f27b272acc10536b"></a>
1061 <h2 class="memtitle"><span class="permalink"><a href="#ga6f26bd75ca7e3247f27b272acc10536b">&#9670;&#160;</a></span>__set_FPSCR()</h2>
1062
1063 <div class="memitem">
1064 <div class="memproto">
1065       <table class="memname">
1066         <tr>
1067           <td class="memname">void __set_FPSCR </td>
1068           <td>(</td>
1069           <td class="paramtype">uint32_t&#160;</td>
1070           <td class="paramname"><em>fpscr</em></td><td>)</td>
1071           <td></td>
1072         </tr>
1073       </table>
1074 </div><div class="memdoc">
1075
1076 <p>Set the FPSC register [only for Cortex-M4 and Cortex-M7]. </p>
1077 <p>The function sets the Floating-Point Status Control Register (FPSCR) value. <br  />
1078 <br  />
1079 FPSCR provides all necessary User level control of the floating-point system. <br  />
1080 </p><ul>
1081 <li><b>N</b> (FPSC[31]) (Negative flag)<ul>
1082 <li>=1 The instruction result has a negative value (when interpreted as signed integer).</li>
1083 <li>=0 The instruction result has a positive value or equal zero. <br  />
1084 <br  />
1085 </li>
1086 </ul>
1087 </li>
1088 <li><b>Z</b> (FPSC[30]) (Zero flag)<ul>
1089 <li>=1 The instruction result is zero. Or, after a compare instruction, when the two values are the same. <br  />
1090 <br  />
1091 </li>
1092 </ul>
1093 </li>
1094 <li><b>C</b> (FPSC[29]) (Carry or borrow flag)<ul>
1095 <li>=1 For unsigned additions, if an unsigned overflow occurred.</li>
1096 <li>=<em>inverse of borrow output status</em> For unsigned subtract operations. <br  />
1097 <br  />
1098 </li>
1099 </ul>
1100 </li>
1101 <li><b>V</b> (FPSC[28]) (Overflow flag)<ul>
1102 <li>=1 A signed overflow occurred (for signed additions or subtractions). <br  />
1103 <br  />
1104 </li>
1105 </ul>
1106 </li>
1107 <li><b>AHP</b> (FPSC[26]) (Alternative half-precision flag)<ul>
1108 <li>=1 Alternative half-precision format selected.</li>
1109 <li>=0 IEEE half-precision format selected. <br  />
1110 <br  />
1111 </li>
1112 </ul>
1113 </li>
1114 <li><b>DN</b> (FPSC[25]) (Default NaN mode control flag)<ul>
1115 <li>=1 Any operation involving one or more NaNs returns the Default NaN.</li>
1116 <li>=0 NaN operands propagate through to the output of a floating-point operation. <br  />
1117 <br  />
1118 </li>
1119 </ul>
1120 </li>
1121 <li><b>FZ</b> (FPSC[24]) (Flush-to-zero mode control flag)<ul>
1122 <li>=1 Flush-to-zero mode enabled.</li>
1123 <li>=0 Flush-to-zero mode disabled. Behavior of the floating-point system is fully compliant with the IEEE 754 standard. <br  />
1124 <br  />
1125 </li>
1126 </ul>
1127 </li>
1128 <li><b>RMode</b> (FPSC[23:22]) (Rounding Mode control flags)<ul>
1129 <li>=0b00 Round to Nearest (RN) mode.</li>
1130 <li>=0b01 Round towards Plus Infinity (RP) mode.</li>
1131 <li>=0b10 Round towards Minus Infinity (RM) mode.</li>
1132 <li>=0b11 Round towards Zero (RZ) mode.</li>
1133 <li>The specified rounding mode is used by almost all floating-point instructions. <br  />
1134 <br  />
1135 </li>
1136 </ul>
1137 </li>
1138 <li><b>IDC</b> (FPSC[7]) (Input Denormal cumulative exception flags)<ul>
1139 <li>See Cumulative exception bits (FPSC[4:0]). <br  />
1140 <br  />
1141 </li>
1142 </ul>
1143 </li>
1144 <li><b>IXC</b> (FPSC[4]) (Inexact cumulative exception flag)<ul>
1145 <li>=1 Exception occurred.</li>
1146 <li>=0 Value has to be set explicitly.</li>
1147 <li>Flag is not cleared automatically. <br  />
1148 <br  />
1149 </li>
1150 </ul>
1151 </li>
1152 <li><b>UFC</b> (FPSC[3]) (Underflow cumulative exception flag)<ul>
1153 <li>=1 Exception occurred.</li>
1154 <li>=0 Value has to be set explicitly.</li>
1155 <li>Flag is not cleared automatically. <br  />
1156 <br  />
1157 </li>
1158 </ul>
1159 </li>
1160 <li><b>OFC</b> (FPSC[2]) (Overflow cumulative exception flag)<ul>
1161 <li>=1 Exception occurred.</li>
1162 <li>=0 Value has to be set explicitly.</li>
1163 <li>Flag is not cleared automatically. <br  />
1164 <br  />
1165 </li>
1166 </ul>
1167 </li>
1168 <li><b>DZC</b> (FPSC[1]) (Division by Zero cumulative exception flag)<ul>
1169 <li>=1 Exception occurred.</li>
1170 <li>=0 Value has to be set explicitly.</li>
1171 <li>Flag is not cleared automatically. <br  />
1172 <br  />
1173 </li>
1174 </ul>
1175 </li>
1176 <li><b>IOC</b> (FPSC[0]) (Invalid Operation cumulative exception flag)<ul>
1177 <li>=1 Exception occurred.</li>
1178 <li>=0 Value has to be set explicitly.</li>
1179 <li>Flag is not cleared automatically.</li>
1180 </ul>
1181 </li>
1182 </ul>
1183 <dl class="params"><dt>Parameters</dt><dd>
1184   <table class="params">
1185     <tr><td class="paramdir">[in]</td><td class="paramname">fpscr</td><td>FPSCR value to set</td></tr>
1186   </table>
1187   </dd>
1188 </dl>
1189 <dl class="section remark"><dt>Remarks</dt><dd><ul>
1190 <li>Only for Cortex-M4 and Cortex-M7.</li>
1191 <li>The variable <b>__FPU_PRESENT</b> has to be set to 1.</li>
1192 </ul>
1193 </dd></dl>
1194 <dl class="section see"><dt>See also</dt><dd><ul>
1195 <li><a class="el" href="group__Core__Register__gr.html#gad6d7eca9ddd1d9072dd7b020cfe64905">__get_FPSCR</a></li>
1196 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
1197 </ul>
1198 </dd></dl>
1199
1200 </div>
1201 </div>
1202 <a id="ga0bf9564ebc1613a8faba014275dac2a4" name="ga0bf9564ebc1613a8faba014275dac2a4"></a>
1203 <h2 class="memtitle"><span class="permalink"><a href="#ga0bf9564ebc1613a8faba014275dac2a4">&#9670;&#160;</a></span>__set_MSP()</h2>
1204
1205 <div class="memitem">
1206 <div class="memproto">
1207       <table class="memname">
1208         <tr>
1209           <td class="memname">void __set_MSP </td>
1210           <td>(</td>
1211           <td class="paramtype">uint32_t&#160;</td>
1212           <td class="paramname"><em>topOfMainStack</em></td><td>)</td>
1213           <td></td>
1214         </tr>
1215       </table>
1216 </div><div class="memdoc">
1217
1218 <p>Set the MSP register. </p>
1219 <p>The function sets the Main Stack Pointer (MSP) value using the instruction <b>MSR</b>. <br  />
1220 <br  />
1221 Physically two different stack pointers (SP) exist:</p><ul>
1222 <li>The Main Stack Pointer (MSP) is the default stack pointer after reset. It is also used when running exception handlers (handler mode).</li>
1223 <li>The Process Stack Pointer (PSP), which can be used only in thread mode.</li>
1224 </ul>
1225 <p>Register R13 banks the SP. The SP selection is determined by the bit[1] of the CONTROL register:</p><ul>
1226 <li>=0 MSP is the current stack pointer. This is also the default SP. The initial value is loaded from the first 32-bit word of the vector table from the program memory.</li>
1227 <li>=1 PSP is the current stack pointer. The initial value is undefined.</li>
1228 </ul>
1229 <dl class="params"><dt>Parameters</dt><dd>
1230   <table class="params">
1231     <tr><td class="paramdir">[in]</td><td class="paramname">topOfMainStack</td><td>MSP value to set</td></tr>
1232   </table>
1233   </dd>
1234 </dl>
1235 <dl class="section remark"><dt>Remarks</dt><dd><ul>
1236 <li>Only one of the two SPs is visible at a time.</li>
1237 <li>For many applications, the system can completely rely on the MSP.</li>
1238 <li>The PSP is normally used in designs with an OS where the stack memory for OS Kernel must be separated from the application code. <br  />
1239 </li>
1240 </ul>
1241 </dd></dl>
1242 <dl class="section see"><dt>See also</dt><dd><ul>
1243 <li><a class="el" href="group__Core__Register__gr.html#gab898559392ba027814e5bbb5a98b38d2">__get_MSP</a>; <a class="el" href="group__Core__Register__gr.html#ga48e5853f417e17a8a65080f6a605b743" title="Set the PSP register.">__set_PSP</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a></li>
1244 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
1245 </ul>
1246 </dd></dl>
1247
1248 </div>
1249 </div>
1250 <a id="ga6809a07c5cb7410e361f3fba57f72172" name="ga6809a07c5cb7410e361f3fba57f72172"></a>
1251 <h2 class="memtitle"><span class="permalink"><a href="#ga6809a07c5cb7410e361f3fba57f72172">&#9670;&#160;</a></span>__set_MSPLIM()</h2>
1252
1253 <div class="memitem">
1254 <div class="memproto">
1255       <table class="memname">
1256         <tr>
1257           <td class="memname">__set_MSPLIM </td>
1258           <td>(</td>
1259           <td class="paramtype">uint32_t&#160;</td>
1260           <td class="paramname"><em>MainStackPtrLimit</em></td><td>)</td>
1261           <td></td>
1262         </tr>
1263       </table>
1264 </div><div class="memdoc">
1265
1266 <p>Set Main Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence the write is silently ignored in non-secure mode. </p>
1267 <p>Assigns the given value to the Main Stack Pointer Limit (MSPLIM). </p><dl class="params"><dt>Parameters</dt><dd>
1268   <table class="params">
1269     <tr><td class="paramdir">[in]</td><td class="paramname">MainStackPtrLimit</td><td>Main Stack Pointer Limit value to set </td></tr>
1270   </table>
1271   </dd>
1272 </dl>
1273 <dl class="section note"><dt>Note</dt><dd>Only available for Armv8-M Architecture. </dd></dl>
1274
1275 </div>
1276 </div>
1277 <a id="ga70b4e1a6c1c86eb913fb9d6e8400156f" name="ga70b4e1a6c1c86eb913fb9d6e8400156f"></a>
1278 <h2 class="memtitle"><span class="permalink"><a href="#ga70b4e1a6c1c86eb913fb9d6e8400156f">&#9670;&#160;</a></span>__set_PRIMASK()</h2>
1279
1280 <div class="memitem">
1281 <div class="memproto">
1282       <table class="memname">
1283         <tr>
1284           <td class="memname">void __set_PRIMASK </td>
1285           <td>(</td>
1286           <td class="paramtype">uint32_t&#160;</td>
1287           <td class="paramname"><em>priMask</em></td><td>)</td>
1288           <td></td>
1289         </tr>
1290       </table>
1291 </div><div class="memdoc">
1292
1293 <p>Set the Priority Mask bit. </p>
1294 <p>The function sets the Priority Mask register (PRIMASK) value using the instruction <b>MSR</b>. <br  />
1295 <br  />
1296 PRIMASK is a 1-bit-wide interrupt mask register. When set, it blocks all interrupts apart from the non-maskable interrupt (NMI) and the hard fault exception. The PRIMASK prevents activation of all exceptions with configurable priority.</p>
1297 <dl class="params"><dt>Parameters</dt><dd>
1298   <table class="params">
1299     <tr><td class="paramdir">[in]</td><td class="paramname">priMask</td><td>Priority Mask<ul>
1300 <li>=0 no effect</li>
1301 <li>=1 prevents the activation of all exceptions with configurable priority</li>
1302 </ul>
1303 </td></tr>
1304   </table>
1305   </dd>
1306 </dl>
1307 <dl class="section remark"><dt>Remarks</dt><dd><ul>
1308 <li>When set, PRIMASK effectively changes the current priority level to 0. This is the highest programmable level.</li>
1309 <li>When set and a fault occurs, the hard fault handler will be executed.</li>
1310 <li>Useful for temporarily disabling all interrupts for timing critical tasks.</li>
1311 <li>Does not have the ability to mask BusFault or bypass MPU.</li>
1312 </ul>
1313 </dd></dl>
1314 <dl class="section see"><dt>See also</dt><dd><ul>
1315 <li><a class="el" href="group__Core__Register__gr.html#ga799b5d9a2ae75e459264c8512c7c0e02">__get_PRIMASK</a>; <a class="el" href="group__Core__Register__gr.html#ga360c73eb7ffb16088556f9278953b882" title="Set the BASEPRI register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_BASEPRI</a>; <a class="el" href="group__Core__Register__gr.html#gaa5587cc09031053a40a35c14ec36078a" title="Set the FAULTMASK register [not for Cortex-M0, Cortex-M0+, or SC000].">__set_FAULTMASK</a></li>
1316 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> <br  />
1317  </li>
1318 </ul>
1319 </dd></dl>
1320
1321 </div>
1322 </div>
1323 <a id="ga48e5853f417e17a8a65080f6a605b743" name="ga48e5853f417e17a8a65080f6a605b743"></a>
1324 <h2 class="memtitle"><span class="permalink"><a href="#ga48e5853f417e17a8a65080f6a605b743">&#9670;&#160;</a></span>__set_PSP()</h2>
1325
1326 <div class="memitem">
1327 <div class="memproto">
1328       <table class="memname">
1329         <tr>
1330           <td class="memname">void __set_PSP </td>
1331           <td>(</td>
1332           <td class="paramtype">uint32_t&#160;</td>
1333           <td class="paramname"><em>topOfProcStack</em></td><td>)</td>
1334           <td></td>
1335         </tr>
1336       </table>
1337 </div><div class="memdoc">
1338
1339 <p>Set the PSP register. </p>
1340 <p>The function sets the Process Stack Pointer (PSP) value using the instruction <b>MSR</b>. <br  />
1341 <br  />
1342 Physically two different stack pointers (SP) exist:</p><ul>
1343 <li>The Main Stack Pointer (MSP) is the default stack pointer after reset. It is also used when running exception handlers (handler mode).</li>
1344 <li>The Process Stack Pointer (PSP), which can be used only in thread mode.</li>
1345 </ul>
1346 <p>Register R13 banks the SP. The SP selection is determined by the bit[1] of the CONTROL register:</p><ul>
1347 <li>=0 MSP is the current stack pointer. This is also the default SP. The initial value is loaded from the first 32-bit word of the vector table from the program memory.</li>
1348 <li>=1 PSP is the current stack pointer. The initial value is undefined.</li>
1349 </ul>
1350 <dl class="params"><dt>Parameters</dt><dd>
1351   <table class="params">
1352     <tr><td class="paramdir">[in]</td><td class="paramname">topOfProcStack</td><td>PSP value to set</td></tr>
1353   </table>
1354   </dd>
1355 </dl>
1356 <dl class="section remark"><dt>Remarks</dt><dd><ul>
1357 <li>Only one of the two SPs is visible at a time.</li>
1358 <li>For many applications, the system can completely rely on the MSP.</li>
1359 <li>The PSP is normally used in designs with an OS where the stack memory for OS Kernel must be separated from the application code. <br  />
1360 </li>
1361 </ul>
1362 </dd></dl>
1363 <dl class="section see"><dt>See also</dt><dd><ul>
1364 <li><a class="el" href="group__Core__Register__gr.html#ga914dfa8eff7ca53380dd54cf1d8bebd9">__get_PSP</a>; <a class="el" href="group__Core__Register__gr.html#ga0bf9564ebc1613a8faba014275dac2a4" title="Set the MSP register.">__set_MSP</a>; <a class="el" href="group__Core__Register__gr.html#gac64d37e7ff9de06437f9fb94bbab8b6c" title="Set the CONTROL Register.">__set_CONTROL</a></li>
1365 <li><a class="el" href="index.html#ref_man_sec">ref_man_sec</a> </li>
1366 </ul>
1367 </dd></dl>
1368
1369 </div>
1370 </div>
1371 <a id="ga4348d14fc5eefbfd34ab8c51be44a81b" name="ga4348d14fc5eefbfd34ab8c51be44a81b"></a>
1372 <h2 class="memtitle"><span class="permalink"><a href="#ga4348d14fc5eefbfd34ab8c51be44a81b">&#9670;&#160;</a></span>__set_PSPLIM()</h2>
1373
1374 <div class="memitem">
1375 <div class="memproto">
1376       <table class="memname">
1377         <tr>
1378           <td class="memname">void __set_PSPLIM </td>
1379           <td>(</td>
1380           <td class="paramtype">uint32_t&#160;</td>
1381           <td class="paramname"><em>ProcStackPtrLimit</em></td><td>)</td>
1382           <td></td>
1383         </tr>
1384       </table>
1385 </div><div class="memdoc">
1386
1387 <p>Set Process Stack Pointer Limit Devices without Armv8-M Main Extensions (i.e. Cortex-M23) lack the non-secure Stack Pointer Limit register hence the write is silently ignored in non-secure mode. </p>
1388 <p>Assigns the given value to the Process Stack Pointer Limit (PSPLIM). </p><dl class="params"><dt>Parameters</dt><dd>
1389   <table class="params">
1390     <tr><td class="paramdir">[in]</td><td class="paramname">ProcStackPtrLimit</td><td>Process Stack Pointer Limit value to set </td></tr>
1391   </table>
1392   </dd>
1393 </dl>
1394 <dl class="section note"><dt>Note</dt><dd>Only available for Armv8-M Architecture. </dd></dl>
1395
1396 </div>
1397 </div>
1398 </div><!-- contents -->
1399 </div><!-- doc-content -->
1400 <!-- start footer part -->
1401 <div id="nav-path" class="navpath"><!-- id is needed for treeview function! -->
1402   <ul>
1403     <li class="footer">
1404       <script type="text/javascript">
1405         <!--
1406         writeFooter.call(this);
1407         //-->
1408       </script>
1409     </li>
1410   </ul>
1411 </div>
1412 </body>
1413 </html>